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SPLD, FPGA, Power management controller, Gate array, System-on-chip
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| ispGDX2 Family Attributes | |||||||||||||||||||||||||||||||||||||||
| ispGDX2-64/E1 | ispGDX21 282/E1 | ispGDX2-256/E1 | |||||||||||||||||||||||||||||||||||||
| Feature | |||||||||||||||||||||||||||||||||||||||
| l/Os GDX Blocks I'PD ts I'co 'max Max. Bandwidth (SERDES) Max. Bandwidth (without SERDES) [sysHSI Channels Bus LVDS (Pairs) PLLs Package 1. "E" series does not support sysHSI. 2. Preliminary information. ispGDX2 Advanced Packaging | |||||||||||||||||||||||||||||||||||||||
| 64 3.0 ns 2.0 ns 2.9 ns 360 MHz 3.2 Gbps 11 Gbps 4 32 2 100-Ball fpBGA | 128 | 256 3.5 ns 2.0 ns 3.2 ns 300 MHz 12.8 Gbps 38 Gbps 16 128 4 484-Ball fpBGA | |||||||||||||||||||||||||||||||||||||
| 64 2 208-Ball fpBGA | |||||||||||||||||||||||||||||||||||||||
| 10(!1 =1 | |||||||||||||||||||||||||||||||||||||||
| i&t'BBtt fpBÜA 23.00 xZUMmm l U mm piixh | |||||||||||||||||||||||||||||||||||||||
| îùBBdtitpacA 17.00 K 17.00 FTUTl iJjnrwipttth | |||||||||||||||||||||||||||||||||||||||
| 11 JOB mi JOD mm 1 Q -TlT p 111 h | |||||||||||||||||||||||||||||||||||||||
| Packages are shown actual size. Dimensions refer to package ho&y size. | |||||||||||||||||||||||||||||||||||||||
| Lattice 'it n-.:o'Ti jc:or ..... CfiffrarMiûr. www.latticesemi.com | |||||||||||||||||||||||||||||||||||||||
| Applications Support 1-800-LATTICE (528-8423) (408) 826-6002 techsupport@latticesemi.com | |||||||||||||||||||||||||||||||||||||||
| Copyright © 2002 Lattice Semiconductor Corporation. Lattice Semiconductor, L (stylized) Lattice Semiconductor Corp., and Lattice (design), ISP, ispGDX. lspGDX2, sysHSI, syslO, sysCLOCK are either registered trademarks or trademarks of Lattice Semiconductor Corporation In the United States and/or other countries. Other product names used In this publication are for Identification purposes only and may be trademarks of their respective companies. | July 2004 Order #: I0147B | ||||||||||||||||||||||||||||||||||||||